TimeQuest Timing Analyzer report for mm32k
Mon Mar 16 23:35:50 2026
Quartus II 64-Bit Version 13.0.1 Build 232 06/12/2013 Service Pack 1 SJ Web Edition


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; Table of Contents ;
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  1. Legal Notice
  2. TimeQuest Timing Analyzer Summary
  3. Parallel Compilation
  4. SDC File List
  5. Clocks
  6. Fmax Summary
  7. Setup Summary
  8. Hold Summary
  9. Recovery Summary
 10. Removal Summary
 11. Minimum Pulse Width Summary
 12. Propagation Delay
 13. Minimum Propagation Delay
 14. Clock Transfers
 15. Report TCCS
 16. Report RSKM
 17. Unconstrained Paths
 18. TimeQuest Timing Analyzer Messages
 19. TimeQuest Timing Analyzer Suppressed Messages



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; Legal Notice ;
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Copyright (C) 1991-2013 Altera Corporation
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
functions, and any output files from any of the foregoing 
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; TimeQuest Timing Analyzer Summary                                                      ;
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; Quartus II Version ; Version 13.0.1 Build 232 06/12/2013 Service Pack 1 SJ Web Edition ;
; Revision Name      ; mm32k                                                             ;
; Device Family      ; MAX7000S                                                          ;
; Device Name        ; EPM7128SLC84-15                                                   ;
; Timing Models      ; Final                                                             ;
; Delay Model        ; Slow Model                                                        ;
; Rise/Fall Delays   ; Unavailable                                                       ;
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Parallel compilation was disabled, but you have multiple processors available. Enable parallel compilation to reduce compilation time.
+-------------------------------------+
; Parallel Compilation                ;
+----------------------------+--------+
; Processors                 ; Number ;
+----------------------------+--------+
; Number detected on machine ; 16     ;
; Maximum allowed            ; 1      ;
+----------------------------+--------+


+------------------------------------------------------------------------------------------------------+
; SDC File List                                                                                        ;
+------------------------------------------------------------------+--------+--------------------------+
; SDC File Path                                                    ; Status ; Read at                  ;
+------------------------------------------------------------------+--------+--------------------------+
; //wsl.localhost/Ubuntu/home/vrs/Verilog/projects/mmu8l/mm32k.sdc ; OK     ; Mon Mar 16 23:35:49 2026 ;
+------------------------------------------------------------------+--------+--------------------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clocks                                                                                                                                                                             ;
+------------+---------+--------+-----------+-------+--------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+---------+
; Clock Name ; Type    ; Period ; Frequency ; Rise  ; Fall   ; Duty Cycle ; Divide by ; Multiply by ; Phase ; Offset ; Edge List ; Edge Shift ; Inverted ; Master ; Source ; Targets ;
+------------+---------+--------+-----------+-------+--------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+---------+
; CLK        ; Virtual ; 50.000 ; 20.0 MHz  ; 0.000 ; 25.000 ;            ;           ;             ;       ;        ;           ;            ;          ;        ;        ; { }     ;
+------------+---------+--------+-----------+-------+--------+------------+-----------+-------------+-------+--------+-----------+------------+----------+--------+--------+---------+


----------------
; Fmax Summary ;
----------------
No paths to report.


-----------------
; Setup Summary ;
-----------------
No paths to report.


----------------
; Hold Summary ;
----------------
No paths to report.


--------------------
; Recovery Summary ;
--------------------
No paths to report.


-------------------
; Removal Summary ;
-------------------
No paths to report.


-------------------------------
; Minimum Pulse Width Summary ;
-------------------------------
No paths to report.


+------------------------------------------------------------------+
; Propagation Delay                                                ;
+------------+-------------+---------+---------+---------+---------+
; Input Port ; Output Port ; RR      ; RF      ; FR      ; FF      ;
+------------+-------------+---------+---------+---------+---------+
; BMB[0]     ; D[0]        ; 15.000  ;         ;         ; 15.000  ;
; BMB[1]     ; D[1]        ; 15.000  ;         ;         ; 15.000  ;
; BMB[2]     ; D[2]        ; 15.000  ;         ;         ; 15.000  ;
; BMB[3]     ; D[3]        ; 15.000  ;         ;         ; 15.000  ;
; BMB[4]     ; D[4]        ; 15.000  ;         ;         ; 15.000  ;
; BMB[5]     ; D[5]        ; 15.000  ;         ;         ; 15.000  ;
; BMB[6]     ; D[6]        ; 15.000  ;         ;         ; 15.000  ;
; BMB[7]     ; D[7]        ; 15.000  ;         ;         ; 15.000  ;
; BMB[8]     ; D[8]        ; 15.000  ;         ;         ; 15.000  ;
; BMB[9]     ; D[9]        ; 15.000  ;         ;         ; 15.000  ;
; BMB[10]    ; D[10]       ; 15.000  ;         ;         ; 15.000  ;
; BMB[11]    ; D[11]       ; 15.000  ;         ;         ; 15.000  ;
; CLK        ; CS_L        ; 267.000 ; 267.000 ; 267.000 ; 267.000 ;
; CLK        ; D[0]        ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; D[1]        ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; D[2]        ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; D[3]        ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; D[4]        ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; D[5]        ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; D[6]        ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; D[7]        ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; D[8]        ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; D[9]        ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; D[10]       ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; D[11]       ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; MEM[0]      ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; MEM[1]      ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; MEM[2]      ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; MEM[3]      ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; MEM[4]      ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; MEM[5]      ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; MEM[6]      ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; MEM[7]      ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; MEM[8]      ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; MEM[9]      ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; MEM[10]     ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; MEM[11]     ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; MEMDONE_L   ; 274.000 ; 283.000 ; 283.000 ; 274.000 ;
; CLK        ; MEM_P       ; 265.000 ; 274.000 ; 274.000 ; 265.000 ;
; CLK        ; OE_L        ; 249.000 ; 258.000 ; 258.000 ; 249.000 ;
; CLK        ; PARITY      ; 274.000 ; 265.000 ; 265.000 ; 274.000 ;
; CLK        ; STROBE_L    ; 274.000 ; 283.000 ; 283.000 ; 274.000 ;
; CLK        ; WE_L        ; 258.000 ; 249.000 ; 249.000 ; 258.000 ;
; D[0]       ; MEM[0]      ; 15.000  ;         ;         ; 15.000  ;
; D[1]       ; MEM[1]      ; 15.000  ;         ;         ; 15.000  ;
; D[2]       ; MEM[2]      ; 15.000  ;         ;         ; 15.000  ;
; D[3]       ; MEM[3]      ; 15.000  ;         ;         ; 15.000  ;
; D[4]       ; MEM[4]      ; 15.000  ;         ;         ; 15.000  ;
; D[5]       ; MEM[5]      ; 15.000  ;         ;         ; 15.000  ;
; D[6]       ; MEM[6]      ; 15.000  ;         ;         ; 15.000  ;
; D[7]       ; MEM[7]      ; 15.000  ;         ;         ; 15.000  ;
; D[8]       ; MEM[8]      ; 15.000  ;         ;         ; 15.000  ;
; D[9]       ; MEM[9]      ; 15.000  ;         ;         ; 15.000  ;
; D[10]      ; MEM[10]     ; 15.000  ;         ;         ; 15.000  ;
; D[11]      ; MEM[11]     ; 15.000  ;         ;         ; 15.000  ;
; EA[0]      ; CS_L        ; 34.000  ; 34.000  ; 34.000  ; 34.000  ;
; EA[0]      ; D[0]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; D[1]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; D[2]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; D[3]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; D[4]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; D[5]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; D[6]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; D[7]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; D[8]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; D[9]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; D[10]       ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; D[11]       ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEM[0]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEM[1]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEM[2]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEM[3]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEM[4]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEM[5]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEM[6]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEM[7]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEM[8]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEM[9]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEM[10]     ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEM[11]     ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; MEMDONE_L   ; 50.000  ; 50.000  ; 50.000  ; 50.000  ;
; EA[0]      ; MEM_P       ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; OE_L        ; 25.000  ; 25.000  ; 25.000  ; 25.000  ;
; EA[0]      ; PARITY      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[0]      ; STROBE_L    ; 50.000  ; 50.000  ; 50.000  ; 50.000  ;
; EA[0]      ; WE_L        ; 25.000  ; 25.000  ; 25.000  ; 25.000  ;
; EA[1]      ; CS_L        ; 34.000  ; 34.000  ; 34.000  ; 34.000  ;
; EA[1]      ; D[0]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; D[1]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; D[2]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; D[3]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; D[4]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; D[5]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; D[6]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; D[7]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; D[8]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; D[9]        ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; D[10]       ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; D[11]       ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; MEM[0]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; MEM[1]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; MEM[2]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; MEM[3]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; MEM[4]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; MEM[5]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; MEM[6]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
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; EA[1]      ; MEM[9]      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; MEM[10]     ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
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; EA[1]      ; MEM_P       ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
; EA[1]      ; OE_L        ; 25.000  ; 25.000  ; 25.000  ; 25.000  ;
; EA[1]      ; PARITY      ; 41.000  ; 41.000  ; 41.000  ; 41.000  ;
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; EA[2]      ; D[2]        ; 40.000  ; 41.000  ; 41.000  ; 40.000  ;
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; EA[2]      ; OE_L        ; 25.000  ; 24.000  ; 24.000  ; 25.000  ;
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; FS_L[0]    ; CS_L        ; 34.000  ; 34.000  ; 34.000  ; 34.000  ;
; FS_L[0]    ; D[0]        ;         ; 41.000  ; 41.000  ;         ;
; FS_L[0]    ; D[1]        ;         ; 41.000  ; 41.000  ;         ;
; FS_L[0]    ; D[2]        ;         ; 41.000  ; 41.000  ;         ;
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; FS_L[0]    ; MEM[9]      ; 41.000  ;         ;         ; 41.000  ;
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; FS_L[0]    ; MEM[11]     ; 41.000  ;         ;         ; 41.000  ;
; FS_L[0]    ; MEMDONE_L   ; 50.000  ;         ;         ; 50.000  ;
; FS_L[0]    ; MEM_P       ; 41.000  ;         ;         ; 41.000  ;
; FS_L[0]    ; OE_L        ; 25.000  ;         ;         ; 25.000  ;
; FS_L[0]    ; PARITY      ;         ; 41.000  ; 41.000  ;         ;
; FS_L[0]    ; STROBE_L    ;         ; 50.000  ; 50.000  ;         ;
; FS_L[0]    ; WE_L        ;         ; 25.000  ; 25.000  ;         ;
; FS_L[1]    ; CS_L        ; 33.000  ; 33.000  ; 33.000  ; 33.000  ;
; FS_L[1]    ; D[0]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[1]    ; D[1]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[1]    ; D[2]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[1]    ; D[3]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[1]    ; D[4]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[1]    ; D[5]        ;         ; 40.000  ; 40.000  ;         ;
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; FS_L[1]    ; D[8]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[1]    ; D[9]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[1]    ; D[10]       ;         ; 40.000  ; 40.000  ;         ;
; FS_L[1]    ; D[11]       ;         ; 40.000  ; 40.000  ;         ;
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; FS_L[1]    ; MEM[2]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[1]    ; MEM[3]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[1]    ; MEM[4]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[1]    ; MEM[5]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[1]    ; MEM[6]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[1]    ; MEM[7]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[1]    ; MEM[8]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[1]    ; MEM[9]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[1]    ; MEM[10]     ; 40.000  ;         ;         ; 40.000  ;
; FS_L[1]    ; MEM[11]     ; 40.000  ;         ;         ; 40.000  ;
; FS_L[1]    ; MEMDONE_L   ; 49.000  ;         ;         ; 49.000  ;
; FS_L[1]    ; MEM_P       ; 40.000  ;         ;         ; 40.000  ;
; FS_L[1]    ; OE_L        ; 24.000  ;         ;         ; 24.000  ;
; FS_L[1]    ; PARITY      ;         ; 40.000  ; 40.000  ;         ;
; FS_L[1]    ; STROBE_L    ;         ; 49.000  ; 49.000  ;         ;
; FS_L[1]    ; WE_L        ;         ; 24.000  ; 24.000  ;         ;
; FS_L[2]    ; CS_L        ; 33.000  ; 33.000  ; 33.000  ; 33.000  ;
; FS_L[2]    ; D[0]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[2]    ; D[1]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[2]    ; D[2]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[2]    ; D[3]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[2]    ; D[4]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[2]    ; D[5]        ;         ; 40.000  ; 40.000  ;         ;
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; FS_L[2]    ; D[8]        ;         ; 40.000  ; 40.000  ;         ;
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; FS_L[2]    ; D[10]       ;         ; 40.000  ; 40.000  ;         ;
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; FS_L[2]    ; MEM[1]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[2]    ; MEM[2]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[2]    ; MEM[3]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[2]    ; MEM[4]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[2]    ; MEM[5]      ; 40.000  ;         ;         ; 40.000  ;
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; FS_L[2]    ; MEM[8]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[2]    ; MEM[9]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[2]    ; MEM[10]     ; 40.000  ;         ;         ; 40.000  ;
; FS_L[2]    ; MEM[11]     ; 40.000  ;         ;         ; 40.000  ;
; FS_L[2]    ; MEMDONE_L   ; 49.000  ;         ;         ; 49.000  ;
; FS_L[2]    ; MEM_P       ; 40.000  ;         ;         ; 40.000  ;
; FS_L[2]    ; OE_L        ; 24.000  ;         ;         ; 24.000  ;
; FS_L[2]    ; PARITY      ;         ; 40.000  ; 40.000  ;         ;
; FS_L[2]    ; STROBE_L    ;         ; 49.000  ; 49.000  ;         ;
; FS_L[2]    ; WE_L        ;         ; 24.000  ; 24.000  ;         ;
; FS_L[3]    ; CS_L        ; 33.000  ; 33.000  ; 33.000  ; 33.000  ;
; FS_L[3]    ; D[0]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[3]    ; D[1]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[3]    ; D[2]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[3]    ; D[3]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[3]    ; D[4]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[3]    ; D[5]        ;         ; 40.000  ; 40.000  ;         ;
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; FS_L[3]    ; OE_L        ; 24.000  ;         ;         ; 24.000  ;
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; FS_L[4]    ; MEM[10]     ; 41.000  ;         ;         ; 41.000  ;
; FS_L[4]    ; MEM[11]     ; 41.000  ;         ;         ; 41.000  ;
; FS_L[4]    ; MEMDONE_L   ; 50.000  ;         ;         ; 50.000  ;
; FS_L[4]    ; MEM_P       ; 41.000  ;         ;         ; 41.000  ;
; FS_L[4]    ; OE_L        ; 25.000  ;         ;         ; 25.000  ;
; FS_L[4]    ; PARITY      ;         ; 41.000  ; 41.000  ;         ;
; FS_L[4]    ; STROBE_L    ;         ; 50.000  ; 50.000  ;         ;
; FS_L[4]    ; WE_L        ;         ; 25.000  ; 25.000  ;         ;
; FS_L[5]    ; CS_L        ; 33.000  ; 33.000  ; 33.000  ; 33.000  ;
; FS_L[5]    ; D[0]        ;         ; 40.000  ; 40.000  ;         ;
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; FS_L[5]    ; D[2]        ;         ; 40.000  ; 40.000  ;         ;
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; FS_L[5]    ; D[5]        ;         ; 40.000  ; 40.000  ;         ;
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; FS_L[5]    ; MEM_P       ; 40.000  ;         ;         ; 40.000  ;
; FS_L[5]    ; OE_L        ; 24.000  ;         ;         ; 24.000  ;
; FS_L[5]    ; PARITY      ;         ; 40.000  ; 40.000  ;         ;
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; FS_L[5]    ; WE_L        ;         ; 24.000  ; 24.000  ;         ;
; FS_L[6]    ; CS_L        ; 34.000  ; 34.000  ; 34.000  ; 34.000  ;
; FS_L[6]    ; D[0]        ;         ; 41.000  ; 41.000  ;         ;
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; FS_L[6]    ; D[2]        ;         ; 41.000  ; 41.000  ;         ;
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; FS_L[6]    ; MEM[3]      ; 41.000  ;         ;         ; 41.000  ;
; FS_L[6]    ; MEM[4]      ; 41.000  ;         ;         ; 41.000  ;
; FS_L[6]    ; MEM[5]      ; 41.000  ;         ;         ; 41.000  ;
; FS_L[6]    ; MEM[6]      ; 41.000  ;         ;         ; 41.000  ;
; FS_L[6]    ; MEM[7]      ; 41.000  ;         ;         ; 41.000  ;
; FS_L[6]    ; MEM[8]      ; 41.000  ;         ;         ; 41.000  ;
; FS_L[6]    ; MEM[9]      ; 41.000  ;         ;         ; 41.000  ;
; FS_L[6]    ; MEM[10]     ; 41.000  ;         ;         ; 41.000  ;
; FS_L[6]    ; MEM[11]     ; 41.000  ;         ;         ; 41.000  ;
; FS_L[6]    ; MEMDONE_L   ; 50.000  ;         ;         ; 50.000  ;
; FS_L[6]    ; MEM_P       ; 41.000  ;         ;         ; 41.000  ;
; FS_L[6]    ; OE_L        ; 25.000  ;         ;         ; 25.000  ;
; FS_L[6]    ; PARITY      ;         ; 41.000  ; 41.000  ;         ;
; FS_L[6]    ; STROBE_L    ;         ; 50.000  ; 50.000  ;         ;
; FS_L[6]    ; WE_L        ;         ; 25.000  ; 25.000  ;         ;
; FS_L[7]    ; CS_L        ; 33.000  ; 33.000  ; 33.000  ; 33.000  ;
; FS_L[7]    ; D[0]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; D[1]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; D[2]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; D[3]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; D[4]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; D[5]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; D[6]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; D[7]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; D[8]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; D[9]        ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; D[10]       ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; D[11]       ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; MEM[0]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; MEM[1]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; MEM[2]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; MEM[3]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; MEM[4]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; MEM[5]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; MEM[6]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; MEM[7]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; MEM[8]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; MEM[9]      ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; MEM[10]     ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; MEM[11]     ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; MEMDONE_L   ; 49.000  ;         ;         ; 49.000  ;
; FS_L[7]    ; MEM_P       ; 40.000  ;         ;         ; 40.000  ;
; FS_L[7]    ; OE_L        ; 24.000  ;         ;         ; 24.000  ;
; FS_L[7]    ; PARITY      ;         ; 40.000  ; 40.000  ;         ;
; FS_L[7]    ; STROBE_L    ;         ; 49.000  ; 49.000  ;         ;
; FS_L[7]    ; WE_L        ;         ; 24.000  ; 24.000  ;         ;
; MBODD_P    ; PARITY      ; 15.000  ;         ;         ; 15.000  ;
; MEMSTART   ; CS_L        ; 267.000 ; 267.000 ; 267.000 ; 267.000 ;
; MEMSTART   ; D[0]        ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; D[1]        ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; D[2]        ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; D[3]        ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; D[4]        ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; D[5]        ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; D[6]        ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; D[7]        ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; D[8]        ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; D[9]        ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; D[10]       ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; D[11]       ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; MEM[0]      ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; MEM[1]      ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; MEM[2]      ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; MEM[3]      ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; MEM[4]      ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; MEM[5]      ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; MEM[6]      ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; MEM[7]      ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; MEM[8]      ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; MEM[9]      ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; MEM[10]     ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; MEM[11]     ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; MEMDONE_L   ; 283.000 ; 265.000 ; 265.000 ; 283.000 ;
; MEMSTART   ; MEM_P       ; 274.000 ; 256.000 ; 256.000 ; 274.000 ;
; MEMSTART   ; OE_L        ; 258.000 ; 240.000 ; 240.000 ; 258.000 ;
; MEMSTART   ; PARITY      ; 256.000 ; 274.000 ; 274.000 ; 256.000 ;
; MEMSTART   ; STROBE_L    ; 283.000 ; 265.000 ; 265.000 ; 283.000 ;
; MEMSTART   ; WE_L        ; 240.000 ; 258.000 ; 258.000 ; 240.000 ;
; PARITY     ; MEM_P       ; 15.000  ;         ;         ; 15.000  ;
; TP2        ; CS_L        ; 34.000  ;         ;         ; 34.000  ;
; TP2        ; D[0]        ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; D[1]        ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; D[2]        ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; D[3]        ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; D[4]        ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; D[5]        ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; D[6]        ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; D[7]        ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; D[8]        ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; D[9]        ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; D[10]       ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; D[11]       ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; MEMDONE_L   ;         ; 50.000  ; 50.000  ;         ;
; TP2        ; PARITY      ; 41.000  ;         ;         ; 41.000  ;
; TP2        ; WE_L        ; 25.000  ;         ;         ; 25.000  ;
+------------+-------------+---------+---------+---------+---------+


+--------------------------------------------------------------+
; Minimum Propagation Delay                                    ;
+------------+-------------+--------+--------+--------+--------+
; Input Port ; Output Port ; RR     ; RF     ; FR     ; FF     ;
+------------+-------------+--------+--------+--------+--------+
; BMB[0]     ; D[0]        ; 15.000 ;        ;        ; 15.000 ;
; BMB[1]     ; D[1]        ; 15.000 ;        ;        ; 15.000 ;
; BMB[2]     ; D[2]        ; 15.000 ;        ;        ; 15.000 ;
; BMB[3]     ; D[3]        ; 15.000 ;        ;        ; 15.000 ;
; BMB[4]     ; D[4]        ; 15.000 ;        ;        ; 15.000 ;
; BMB[5]     ; D[5]        ; 15.000 ;        ;        ; 15.000 ;
; BMB[6]     ; D[6]        ; 15.000 ;        ;        ; 15.000 ;
; BMB[7]     ; D[7]        ; 15.000 ;        ;        ; 15.000 ;
; BMB[8]     ; D[8]        ; 15.000 ;        ;        ; 15.000 ;
; BMB[9]     ; D[9]        ; 15.000 ;        ;        ; 15.000 ;
; BMB[10]    ; D[10]       ; 15.000 ;        ;        ; 15.000 ;
; BMB[11]    ; D[11]       ; 15.000 ;        ;        ; 15.000 ;
; CLK        ; CS_L        ; 33.000 ; 33.000 ; 33.000 ; 33.000 ;
; CLK        ; D[0]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; D[1]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; D[2]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; D[3]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; D[4]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; D[5]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; D[6]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; D[7]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; D[8]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; D[9]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; D[10]       ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; D[11]       ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEM[0]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEM[1]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEM[2]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEM[3]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEM[4]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEM[5]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEM[6]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEM[7]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEM[8]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEM[9]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEM[10]     ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEM[11]     ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; MEMDONE_L   ; 32.000 ; 32.000 ; 32.000 ; 32.000 ;
; CLK        ; MEM_P       ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; OE_L        ; 24.000 ; 24.000 ; 24.000 ; 24.000 ;
; CLK        ; PARITY      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; CLK        ; STROBE_L    ; 32.000 ; 32.000 ; 32.000 ; 32.000 ;
; CLK        ; WE_L        ; 24.000 ; 24.000 ; 24.000 ; 24.000 ;
; D[0]       ; MEM[0]      ; 15.000 ;        ;        ; 15.000 ;
; D[1]       ; MEM[1]      ; 15.000 ;        ;        ; 15.000 ;
; D[2]       ; MEM[2]      ; 15.000 ;        ;        ; 15.000 ;
; D[3]       ; MEM[3]      ; 15.000 ;        ;        ; 15.000 ;
; D[4]       ; MEM[4]      ; 15.000 ;        ;        ; 15.000 ;
; D[5]       ; MEM[5]      ; 15.000 ;        ;        ; 15.000 ;
; D[6]       ; MEM[6]      ; 15.000 ;        ;        ; 15.000 ;
; D[7]       ; MEM[7]      ; 15.000 ;        ;        ; 15.000 ;
; D[8]       ; MEM[8]      ; 15.000 ;        ;        ; 15.000 ;
; D[9]       ; MEM[9]      ; 15.000 ;        ;        ; 15.000 ;
; D[10]      ; MEM[10]     ; 15.000 ;        ;        ; 15.000 ;
; D[11]      ; MEM[11]     ; 15.000 ;        ;        ; 15.000 ;
; EA[0]      ; CS_L        ; 33.000 ; 33.000 ; 33.000 ; 33.000 ;
; EA[0]      ; D[0]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; EA[0]      ; D[1]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; EA[0]      ; D[2]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; EA[0]      ; D[3]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; EA[0]      ; D[4]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; EA[0]      ; D[5]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; EA[0]      ; D[6]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; EA[0]      ; D[7]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; EA[0]      ; D[8]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
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; FS_L[1]    ; D[2]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[1]    ; D[3]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[1]    ; D[4]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[1]    ; D[5]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[1]    ; D[6]        ;        ; 40.000 ; 40.000 ;        ;
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; FS_L[1]    ; MEM[5]      ; 40.000 ;        ;        ; 40.000 ;
; FS_L[1]    ; MEM[6]      ; 40.000 ;        ;        ; 40.000 ;
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; FS_L[1]    ; MEMDONE_L   ; 33.000 ;        ;        ; 33.000 ;
; FS_L[1]    ; MEM_P       ; 40.000 ;        ;        ; 40.000 ;
; FS_L[1]    ; OE_L        ; 24.000 ;        ;        ; 24.000 ;
; FS_L[1]    ; PARITY      ;        ; 40.000 ; 40.000 ;        ;
; FS_L[1]    ; STROBE_L    ;        ; 33.000 ; 33.000 ;        ;
; FS_L[1]    ; WE_L        ;        ; 24.000 ; 24.000 ;        ;
; FS_L[2]    ; CS_L        ; 33.000 ; 33.000 ; 33.000 ; 33.000 ;
; FS_L[2]    ; D[0]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[2]    ; D[1]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[2]    ; D[2]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[2]    ; D[3]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[2]    ; D[4]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[2]    ; D[5]        ;        ; 40.000 ; 40.000 ;        ;
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; FS_L[3]    ; D[3]        ;        ; 40.000 ; 40.000 ;        ;
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; FS_L[3]    ; PARITY      ;        ; 40.000 ; 40.000 ;        ;
; FS_L[3]    ; STROBE_L    ;        ; 33.000 ; 33.000 ;        ;
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; FS_L[4]    ; D[4]        ;        ; 41.000 ; 41.000 ;        ;
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; FS_L[5]    ; D[3]        ;        ; 40.000 ; 40.000 ;        ;
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; FS_L[5]    ; MEM_P       ; 40.000 ;        ;        ; 40.000 ;
; FS_L[5]    ; OE_L        ; 24.000 ;        ;        ; 24.000 ;
; FS_L[5]    ; PARITY      ;        ; 40.000 ; 40.000 ;        ;
; FS_L[5]    ; STROBE_L    ;        ; 33.000 ; 33.000 ;        ;
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; FS_L[6]    ; MEM[6]      ; 41.000 ;        ;        ; 41.000 ;
; FS_L[6]    ; MEM[7]      ; 41.000 ;        ;        ; 41.000 ;
; FS_L[6]    ; MEM[8]      ; 41.000 ;        ;        ; 41.000 ;
; FS_L[6]    ; MEM[9]      ; 41.000 ;        ;        ; 41.000 ;
; FS_L[6]    ; MEM[10]     ; 41.000 ;        ;        ; 41.000 ;
; FS_L[6]    ; MEM[11]     ; 41.000 ;        ;        ; 41.000 ;
; FS_L[6]    ; MEMDONE_L   ; 34.000 ;        ;        ; 34.000 ;
; FS_L[6]    ; MEM_P       ; 41.000 ;        ;        ; 41.000 ;
; FS_L[6]    ; OE_L        ; 25.000 ;        ;        ; 25.000 ;
; FS_L[6]    ; PARITY      ;        ; 41.000 ; 41.000 ;        ;
; FS_L[6]    ; STROBE_L    ;        ; 34.000 ; 34.000 ;        ;
; FS_L[6]    ; WE_L        ;        ; 25.000 ; 25.000 ;        ;
; FS_L[7]    ; CS_L        ; 33.000 ; 33.000 ; 33.000 ; 33.000 ;
; FS_L[7]    ; D[0]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; D[1]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; D[2]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; D[3]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; D[4]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; D[5]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; D[6]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; D[7]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; D[8]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; D[9]        ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; D[10]       ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; D[11]       ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; MEM[0]      ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; MEM[1]      ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; MEM[2]      ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; MEM[3]      ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; MEM[4]      ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; MEM[5]      ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; MEM[6]      ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; MEM[7]      ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; MEM[8]      ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; MEM[9]      ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; MEM[10]     ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; MEM[11]     ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; MEMDONE_L   ; 33.000 ;        ;        ; 33.000 ;
; FS_L[7]    ; MEM_P       ; 40.000 ;        ;        ; 40.000 ;
; FS_L[7]    ; OE_L        ; 24.000 ;        ;        ; 24.000 ;
; FS_L[7]    ; PARITY      ;        ; 40.000 ; 40.000 ;        ;
; FS_L[7]    ; STROBE_L    ;        ; 33.000 ; 33.000 ;        ;
; FS_L[7]    ; WE_L        ;        ; 24.000 ; 24.000 ;        ;
; MBODD_P    ; PARITY      ; 15.000 ;        ;        ; 15.000 ;
; MEMSTART   ; CS_L        ; 33.000 ; 33.000 ; 33.000 ; 33.000 ;
; MEMSTART   ; D[0]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; D[1]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; D[2]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; D[3]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; D[4]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; D[5]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; D[6]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; D[7]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; D[8]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; D[9]        ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; D[10]       ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; D[11]       ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEM[0]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEM[1]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEM[2]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEM[3]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEM[4]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEM[5]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEM[6]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEM[7]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEM[8]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEM[9]      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEM[10]     ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEM[11]     ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; MEMDONE_L   ; 32.000 ; 32.000 ; 32.000 ; 32.000 ;
; MEMSTART   ; MEM_P       ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; OE_L        ; 24.000 ; 24.000 ; 24.000 ; 24.000 ;
; MEMSTART   ; PARITY      ; 40.000 ; 40.000 ; 40.000 ; 40.000 ;
; MEMSTART   ; STROBE_L    ; 32.000 ; 32.000 ; 32.000 ; 32.000 ;
; MEMSTART   ; WE_L        ; 24.000 ; 24.000 ; 24.000 ; 24.000 ;
; PARITY     ; MEM_P       ; 15.000 ;        ;        ; 15.000 ;
; TP2        ; CS_L        ; 33.000 ;        ;        ; 33.000 ;
; TP2        ; D[0]        ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; D[1]        ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; D[2]        ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; D[3]        ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; D[4]        ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; D[5]        ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; D[6]        ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; D[7]        ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; D[8]        ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; D[9]        ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; D[10]       ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; D[11]       ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; MEMDONE_L   ;        ; 33.000 ; 33.000 ;        ;
; TP2        ; PARITY      ; 40.000 ;        ;        ; 40.000 ;
; TP2        ; WE_L        ; 24.000 ;        ;        ; 24.000 ;
+------------+-------------+--------+--------+--------+--------+


-------------------
; Clock Transfers ;
-------------------
Nothing to report.


---------------
; Report TCCS ;
---------------
No dedicated SERDES Transmitter circuitry present in device or used in design


---------------
; Report RSKM ;
---------------
No dedicated SERDES Receiver circuitry present in device or used in design


+------------------------------------------------+
; Unconstrained Paths                            ;
+---------------------------------+-------+------+
; Property                        ; Setup ; Hold ;
+---------------------------------+-------+------+
; Illegal Clocks                  ; 0     ; 0    ;
; Unconstrained Clocks            ; 0     ; 0    ;
; Unconstrained Input Ports       ; 40    ; 40   ;
; Unconstrained Input Port Paths  ; 445   ; 445  ;
; Unconstrained Output Ports      ; 31    ; 31   ;
; Unconstrained Output Port Paths ; 445   ; 445  ;
+---------------------------------+-------+------+


+------------------------------------+
; TimeQuest Timing Analyzer Messages ;
+------------------------------------+
Info: *******************************************************************
Info: Running Quartus II 64-Bit TimeQuest Timing Analyzer
    Info: Version 13.0.1 Build 232 06/12/2013 Service Pack 1 SJ Web Edition
    Info: Processing started: Mon Mar 16 23:35:48 2026
Info: Command: quartus_sta mm32k -c mm32k
Info: qsta_default_script.tcl version: #1
Info (306004): Started post-fitting delay annotation
Info (306005): Delay annotation completed successfully
Warning (335095): TimeQuest Timing Analyzer does not support the analysis of latches as synchronous elements for the currently selected device family.
Info (332104): Reading SDC File: '//wsl.localhost/Ubuntu/home/vrs/Verilog/projects/mmu8l/mm32k.sdc'
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "memdone~9|[0]"
    Warning (332126): Node "memdone~9|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "strobe~9|[0]"
    Warning (332126): Node "strobe~9|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "ddelay~9|[1]"
    Warning (332126): Node "ddelay~9|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "sdelay~9|[0]"
    Warning (332126): Node "sdelay~9|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "WE_L$latch~9|[1]"
    Warning (332126): Node "WE_L$latch~9|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "OE_L$latch~9|[1]"
    Warning (332126): Node "OE_L$latch~9|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[13]~151|[3]"
    Warning (332126): Node "mt[13]~151|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[13]~142|[3]"
    Warning (332126): Node "mtnext[13]~142|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[12]~147|[3]"
    Warning (332126): Node "mt[12]~147|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[12]~138|[3]"
    Warning (332126): Node "mtnext[12]~138|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[11]~143|[3]"
    Warning (332126): Node "mt[11]~143|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[11]~134|[3]"
    Warning (332126): Node "mtnext[11]~134|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[10]~139|[3]"
    Warning (332126): Node "mt[10]~139|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[10]~130|[3]"
    Warning (332126): Node "mtnext[10]~130|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[9]~135|[3]"
    Warning (332126): Node "mt[9]~135|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[9]~126|[3]"
    Warning (332126): Node "mtnext[9]~126|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[8]~131|[3]"
    Warning (332126): Node "mt[8]~131|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[8]~122|[3]"
    Warning (332126): Node "mtnext[8]~122|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[7]~127|[3]"
    Warning (332126): Node "mt[7]~127|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[7]~118|[3]"
    Warning (332126): Node "mtnext[7]~118|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[6]~123|[3]"
    Warning (332126): Node "mt[6]~123|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[6]~114|[3]"
    Warning (332126): Node "mtnext[6]~114|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[5]~119|[3]"
    Warning (332126): Node "mt[5]~119|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[5]~110|[3]"
    Warning (332126): Node "mtnext[5]~110|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[4]~115|[3]"
    Warning (332126): Node "mt[4]~115|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[4]~106|[3]"
    Warning (332126): Node "mtnext[4]~106|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[3]~111|[3]"
    Warning (332126): Node "mt[3]~111|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[3]~102|[3]"
    Warning (332126): Node "mtnext[3]~102|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[2]~107|[3]"
    Warning (332126): Node "mt[2]~107|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[2]~98|[3]"
    Warning (332126): Node "mtnext[2]~98|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[1]~103|[3]"
    Warning (332126): Node "mt[1]~103|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mtnext[1]~93|[2]"
    Warning (332126): Node "mtnext[1]~93|dataout"
Warning (332125): Found combinational loop of 2 nodes
    Warning (332126): Node "mt[0]~99|[1]"
    Warning (332126): Node "mt[0]~99|dataout"
Warning (332061): Virtual clock CLK is never referenced in any input or output delay assignment.
Info: Found TIMEQUEST_REPORT_SCRIPT_INCLUDE_DEFAULT_ANALYSIS = ON
Info (332140): No fmax paths to report
Info (332140): No Setup paths to report
Info (332140): No Hold paths to report
Info (332140): No Recovery paths to report
Info (332140): No Removal paths to report
Info (332140): No Minimum Pulse Width paths to report
Info (332001): The selected device family is not supported by the report_metastability command.
Info (332102): Design is not fully constrained for setup requirements
Info (332102): Design is not fully constrained for hold requirements
Info (144001): Generated suppressed messages file //wsl.localhost/Ubuntu/home/vrs/Verilog/projects/mmu8l/mm32k.sta.smsg
Info: Quartus II 64-Bit TimeQuest Timing Analyzer was successful. 0 errors, 101 warnings
    Info: Peak virtual memory: 4520 megabytes
    Info: Processing ended: Mon Mar 16 23:35:50 2026
    Info: Elapsed time: 00:00:02
    Info: Total CPU time (on all processors): 00:00:01


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; TimeQuest Timing Analyzer Suppressed Messages ;
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The suppressed messages can be found in //wsl.localhost/Ubuntu/home/vrs/Verilog/projects/mmu8l/mm32k.sta.smsg.


